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您现在所处的位置： 首页 > 数字电视 > 信源编解码 > 正文 H.264中高吞吐量算术编码器的FPGA实现 2008年6月19日 09:46      作者:王琨 陈新 H.264是国际上最新、最有前途的视频压缩标准，基于上下文的二进制算术编码器（CABAC）是H.264中一种高效的熵编码器，但其算法比较复杂，吞吐量不高。为此，提出了一种高吞吐量算术编码器的电路结构。在递归过程中，通过对两个符号的同时处理而提高吞吐量，从而提高编码速度。整体的电路采用流水线结构，该结构在spartan3 FPGA上实现，编码速度达到2bits/cycle，最高的时钟频率可达67.5MHz。 点此查看全文    FPGA软核之战点燃创新激情    FPGA与DDR3 SDRAM的接口设计    运动控制和混合信号FPGA的应用    FPGA在汽车核心电子系统中的前景    一种新的通用SPI总线的FPGA实现方法    基于VirtexE FPGA的视频解码芯片验证平台    基于FPGA无链表SPIHT算法的实现    ARM7与FPGA在工控和故障检测中的应用 用户名：   密码：    您尚未登录系统，若想用实名发表，请先登录。 匿名发表

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